2024年河南科技大學(xué)非全日制研究生招生考試《集成電路基礎(chǔ)》考試大綱
一、考試基本要求及適用范圍概述
要求考生全面、系統(tǒng)地掌握集成電路的基礎(chǔ)理論、基本知識和基本技能，具備集成電路設(shè)計能力，能熟練掌握集成電路的結(jié)構(gòu)特點(diǎn)、工作原理和電路分析方法及制造工藝，理解集成電路設(shè)計的概念和方法，熟練掌握解決工程實(shí)際問題的綜合能力。
本考試大綱適用于河南科技大學(xué)電子科學(xué)與技術(shù)、集成電路工程專業(yè)碩士研究生招生考試的非全日制本科、同等學(xué)力考生的復(fù)試加試環(huán)節(jié)。
二、考試形式
考試采取閉卷筆試形式，考試時間120分鐘，總分100分。
三、考試內(nèi)容
1、集成電路基本結(jié)構(gòu)和制作工藝;N阱CMOS工藝，深亞微米CMOS工藝，SOI CMOS和BiCMOS結(jié)構(gòu)和工藝，n阱CMOS工藝的版圖設(shè)計規(guī)則。
2、集成電路中的器件及模型;MOS晶體管的基本原理和SPICE模型參數(shù)，雙極晶體管的基本原理和SPICE模型參數(shù)。
3、數(shù)字集成電路的基本單元電路;CMOS反相器、靜態(tài)CMOS邏輯電路、動態(tài)CMOS邏輯電路、CMOS邏輯電路的功耗、傳輸門邏輯電路設(shè)計，雙極型邏輯電路。
4、數(shù)字集成電路中的基本模塊;組合邏輯電路、時序邏輯電路分析與設(shè)計。
5、CMOS集成電路的I/O設(shè)計與MOS存儲器;CMOS集成電路輸入、輸出緩沖器的設(shè)計，存儲器的總體結(jié)構(gòu)以及基本存儲單元電路。
6、集成電路的設(shè)計方法和版圖設(shè)計;集成電路的設(shè)計過程及要求，設(shè)計方法和版圖設(shè)計。
四、主要參考教材(參考書目)
1、賈嵩等編.集成電路原理與設(shè)計.第2版.北京：北京大學(xué)出版社，2022年.
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